武汉PCB设计中的常见问题

走线是PCB设计中最重要的环节之一，接下来跟深亚电子一起来看看工程师在PCB走线时经常会遇到哪些问题。

1、如何解决高速信号的手工布线和自动布线之间的矛盾?

答：现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家 EDA公司的绕线引擎能力和约束条件的设定项目有时相差甚远。 例如, 是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式, 能否控制差分对的走线间距等。 这会影响到自动布线出来的走线方式是否能符合设计者的想法。 另外, 手动调整布线的难易也与绕线引擎的能力有绝对的关系。 例如, 走线的推挤能力,过孔的推挤能力, 甚至走线对敷铜的推挤能力等等。所以, 选择一个绕线引擎能力强的布线器, 才是解决之道。

2、差分信号线中间可否加地线?

差分信号中间一般是不能加地线。因为差分信号的应用原理最重要的一点便是利用差分信号间相互耦合(coupling)所带来的好处，如 flux cancellation，抗噪声(noise immunity)能力等。若在中间加地线，便会破坏耦合效应。

3、高频信号布线时要注意哪些问题？

答：1.信号线的阻抗匹配；2.与其他信号线的空间隔离；3.对于数字高频信号，差分线效果会更好；

4、高速中的蛇形走线，适合在那种情况？有什么缺点没，比如对于差分走线，又要求两组信号是正交的。

答：蛇形走线，因为应用场合不同而具不同的作用：

（1）如果蛇形走线在计算机板中出现，其主要起到一个滤波电感和阻抗匹配的作用，提高电路的抗干扰能力。计算机主机板中的蛇形走线，主要用在一些时钟信号中，如PCI-Clk,AGPCIK,IDE,DIMM等信号线。

（2）若在一般普通PCB板中，除了具有滤波电感的作用外，还可作为收音机天线的电感线圈等等。如2.4G的对讲机中就用作电感。

（3）对一些信号布线长度要求必须严格等长，高速数字PCB板的等线长是为了使各信号的延迟差保持在一个范围内，保证系统在同一周期内读取的数据的有效性（延迟差超过一个时钟周期时会错读下一周期的数据）。如INTELHUB架构中的HUBLink，一共13根，使用233MHz的频率，要求必须严格等长，以消除时滞造成的隐患，绕线是惟一的解决办法。一般要求延迟差不超过1/4时钟周期，单位长度的线延迟差也是固定的，延迟跟线宽、线长、铜厚、板层结构有关，但线过长会增大分布电容和分布电感，使信号质量有所下降。所以时钟IC引脚一般都接;" 端接，但蛇形走线并非起电感的作用。相反地，电感会使信号中的上升沿中的高次谐波相移，造成信号质量恶化，所以要求蛇形线间距最少是线宽的两倍。信号的上升时间越小，就越易受分布电容和分布电感的影响。

（4）蛇形走线在某些特殊的电路中起到一个分布参数的LC滤波器的作用。

5、PCB板设计中电源走线的粗细如何选取？有什么规则吗?

答：可以参考：0.15×线宽(mm)=A,也需要考虑铜厚

6、数据线并行布线是不是为了相互干扰？

答：并行走线要注意线与线的间距，防止串扰发生。

7、6层设计时，层的分配技巧，那些走线要走中间层 ？

答：看你的设计了。原则是保证模拟信号线和模拟地有单独两层。

8、多大频率的晶振要考虑MCU与晶振间的走线方式？

答：晶振与MCU应尽量靠近，用最短的直线连接。

9、高速PCB，布线过程中过孔的避让如何处理，有什么好的建议？

答：高速PCB，最好少打过孔，通过增加信号层来解决需要增加过孔的需求。

10、如何避免布线时引入的噪声？

答：数字地与模拟地要单点接地，否则数字地回流会流过模拟地对模拟电路造成干扰。

11、见PCB板的布线折弯时有45度角和圆弧两种，有何优缺点，怎么选择？

答：从阻抗匹配的角度，这两种线都可以做成匹配的弯角。但是圆角可能不好加工。

12、电路中有高速逻辑器件时，最大布线长度为多大？

答：布线不怕长，就怕不对称或者有比较大的差，这样容易因为时延造成错误的逻辑。